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文檔簡介
1、背光模組工廠PE部產(chǎn)品信息組LVDS信號原理及相關介紹背光模組工廠/李明收集背光模組工廠PE部產(chǎn)品信息組目目 錄錄一:一: 簡述簡述二二: LVDS: LVDS信號介紹信號介紹 三:三: LVDS LVDS工作原理工作原理四:四: LVDS LVDS信號信號VidVid的技術要求和測試方法的技術要求和測試方法五:五: 實際應用中常見問題實際應用中常見問題 六:六: 時序設置時序設置七:七: 配屏軟件設置配屏軟件設置一、簡述:一、簡述: LVDS:Low Voltage Differential Signaling,低電壓差分信號; 20世紀90年代在美國NS公司(美國半導體公司)提出的一種數(shù)據(jù)
2、傳輸?shù)慕涌诩夹g,即 LVDS 接口傳輸數(shù)據(jù),這種技術的核心是采用極低的電壓擺幅高速差動傳輸數(shù)據(jù),可以實現(xiàn)點對點或一點對多點的連接,具有低功耗、低誤碼率、低串擾和低輻射等特點,其傳輸介質(zhì)可以是銅質(zhì)的PCB連線,也可以是平衡電纜,LVDS在對信號完整性、低抖動及共模特性要求較高的系統(tǒng)中得到了越來越廣泛的應用。 液晶電視(包括液晶顯示器)驅(qū)動輸出的信號中,除了包括RGB數(shù)據(jù)信號外,還包括行同步、場同步、像素、時鐘 等等信號,其中像素、時鐘信號的最高頻率可超過28MHz,信號接口主要有兩種方式,早期的屏主要是TTL電平信號接口,后期的屏主要是LVDS低電壓差分信號接口; TTL電平信號接口的特點是:R
3、、G、B 三組數(shù)字信號輸入方式,信號電平較高,數(shù)據(jù)傳輸速率不高,傳輸距離較短,且抗電磁干擾(EMI)能力也比較差,會對 R、G、B 數(shù)據(jù)造成一定的影響,另外,TTL多路數(shù)據(jù)信號采用排線的方式來傳送,整個排線數(shù)量達幾十路,不但連接不便,而且不適合超薄化的趨勢;二、二、LVDSLVDS信號介紹:信號介紹: LVDS 低電壓差分接口的特點是:以8-bit 屏為例,有5組傳輸線(包括:4組是數(shù)據(jù)線及1組是時鐘信號),對應在Panel一端有5組接收線;如果是6-bit 屏則只有3組數(shù)據(jù)線和1組時鐘線;每組線中的信號分別為正、負極性信號,信號板到屏的連接線每組線呈絞線狀,信號幅度只有1伏多,EMI輻射小,
4、差分對信號抗干擾能力強,因此現(xiàn)在基本都為LVDS接口的方式,實現(xiàn)了數(shù)據(jù)的高速率、低噪聲、遠距離、高準確度的傳輸,可以克服TTL電平方式傳輸寬帶高碼率數(shù)據(jù)時功耗大、EMI電磁干擾大等缺點而研制的一種數(shù)字視頻信號傳輸方式。 LVDS傳輸支持速率一般在155Mbps(大約為77MHZ)以上; LVDS是一種低擺幅差分信號技術,它使得信號能在差分PCB線對平衡電纜上以幾百Mbps的速率傳輸,其低電壓和低電流驅(qū)動輸出實現(xiàn)了低噪聲和低功耗; IEEE(美國電子、電氣工程師協(xié)會)在兩個標準中對LVDS信號進行了定義,推薦最大速率為655Mbps,理論極限速率為1.923Mbps; LVDS低電壓差分信號是一
5、種高速串行信號傳輸電平,由于它傳輸速度快,功耗低,抗干擾能力強,傳輸距離遠,易于匹配等優(yōu)點,迅速得到諸多芯片制造廠商和應用商的青睞;三、三、 LVDSLVDS工作原理工作原理: 1、LVDS信號傳輸組成: LVDS LVDS信號傳輸由三部分組成:信號傳輸由三部分組成:差分信號發(fā)送器、差分信號互聯(lián)器、差分信號接收器; 差分差分信號發(fā)送器:信號發(fā)送器:將非平衡傳輸?shù)腡TL電平信號轉(zhuǎn)換成平衡傳輸?shù)腖VDS差分信號,通常由一個IC來完成; 差分差分信號接收器:信號接收器:將平衡傳輸?shù)腖VDS差分信號轉(zhuǎn)換成非平衡傳輸?shù)腡TL電平信號,通常由一個IC來完成; 差分差分信號互聯(lián)器:信號互聯(lián)器:包括聯(lián)接線(電
6、纜或者PCB走線),終端匹配電阻。按照IEEE規(guī)定,電阻為100歐,我們通常選擇為100歐 或 120歐。 TTL TTL電平的定義:電平的定義:電路的第一代是電子管,第二代是晶體管(Transistor Transistor Logic),由于集成電路發(fā)展迅猛,各大廠商競相出臺自己的電平標準,導致各芯片之間的連接出現(xiàn)一些接口電路,這也導致額外的浪費,后來才統(tǒng)一了晶體管集成電路的端口電平范圍; TTLTTL電平規(guī)定范圍:電平規(guī)定范圍:電平是個電壓范圍,規(guī)定輸出高電平2.4V,輸出低電平=2.0V,輸入低電平=0.8V,噪聲容限是0.4V。 最基本的LVDS器件就是LVDS驅(qū)動器和接收器。LVD
7、S的驅(qū)動器由驅(qū)動差分線對的電流源組成,電流通常為3.5 mA。LVDS接收器具有很高的輸入阻抗,因此驅(qū)動器輸出的大部分電流都流過100 的匹配電阻,并在接收器的輸入端產(chǎn)生大約350 mV的電壓。當驅(qū)動器翻轉(zhuǎn)時,它改變流經(jīng)電阻的電流方向,因此產(chǎn)生有效的邏輯“1”和邏輯“0”狀態(tài)。由邏輯“0”電平變化到邏輯“1”電平是需要時間的。由于LVDS信號物理電平變化在0.851.55V之間,其由邏輯“0”電平到邏輯“1”電平變化的時間比TTL電平要快得多,所以LVDS更適合用來傳輸高速變化信號。其低壓特點,功耗也低。下圖為LVDS與PECL(光收發(fā)器使用的電平)電平變化:2 2、 LVDS LVDS信號電
8、平特性:信號電平特性: LVDS物理接口使用1.2V偏置電壓作為基準,提供大約400mV擺幅。 LVDS驅(qū)動器由一個驅(qū)動差分線對的電流源組成(通常電流為3.5mA),LVDS接收器具有很高的輸入阻抗,因此驅(qū)動器輸出的電流大部分都流過100的匹配電阻,并在接收器的輸入端產(chǎn)生大約350mV 的電壓; 電流源為恒流特性,終端電阻在100120歐姆之間,則電壓擺動幅度為:3.5mA * 100 = 350mV ;3.5mA * 120 = 420mV 。 低擺幅(約為350 mV)。低電流驅(qū)動模式意味著可實現(xiàn)高速傳輸。ANSI/TIA/EIA644建議了655 Mb/s的最大速率和1.923 Gb/s
9、的無失真通道上的理論極限速率; 低壓擺幅。恒流源電流驅(qū)動,把輸出電流限制到約為3.5 mA左右,使跳變期間的尖峰干擾最小,因而產(chǎn)生的功耗非常小。這允許集成電路密度的進一步提高,即提高了PCB板的效能,減少了成本; 具有相對較慢的邊緣速率(dV/dt約為0.300 V/0.3 ns,即為1 V/ns),同時采用差分傳輸形式,使其信號噪聲和EMI都大為減少,同時也具有較強的抗干擾能力;所以,LVDS具有高速、超低功耗、低噪聲和低成本的優(yōu)良特性。3 3、差分信號抗噪特性、差分信號抗噪特性 :從差分信號傳輸線路上可以看出,若是理想狀況,線路沒有干擾時,在發(fā)送側(cè),可以形象理解為: 噪聲被抑止掉。 上述可
10、以形象理解差分方式抑止噪聲的能力。在實際芯片中,是在噪聲容限內(nèi),采用“比較”及“量化”來處理的。 LVDS接收器可以承受至少1V的驅(qū)動器與接收器之間的地的電壓變化。由于LVDS驅(qū)動器典型的偏置電壓為+1.2V,地的電壓變化、驅(qū)動器偏置電壓以及輕度耦合到的噪聲之和,在接收器的輸入端相對于接收器的地是共模電壓。這個共模范圍是:+0.2V+2.2V。建議接收器的輸入電壓范圍為:0V+2.4V。 抑止共模噪聲是DS(差分信號)的共同特性,采用差分平衡傳輸,由于其電平幅度大,更不容易受干擾,適合工業(yè)現(xiàn)場不太惡劣環(huán)境下通訊。四、四、LVDSLVDS信號信號VidVid的技術要求和測試方法:的技術要求和測試
11、方法:五、實際應用中常見問題五、實際應用中常見問題 :1 1、PCBPCB走線要求走線要求 :2 2、PCBPCB 過孔過孔要求:要求: 一般原則:對于高速信號,盡量減少過孔;信號速度低于155Mbps,使用過孔也無妨; 對于表面貼片器件,其管腳的LVDS信號走線在PCB表層或者底層,盡量使用“微帶布線”方式,避免使用過孔聯(lián)接信號; 對于插件器件,由于不使用過孔,其信號線本就可以聯(lián)接到PCB的“中間層”,這樣一來,盡量使用“帶狀走線”,其性能更好。六、六、 時序設置:時序設置: 1 1、時序要求:、時序要求: 不同品牌/供應商、不同尺寸的屏時序均不盡相同,舉例 :2 2、時序異常的影響:、時序異常的影響: 屏參信息中比較重要的設定有如下幾個:屏參信息中比較重要的設定有如下幾個:1. 屏上電時序;BYTE m_PANEL_ON_TIMING1 / time between panel & data while turn on powerBYTE m_ucPanelOnTiming2; / time between data & back light while turn on powerBYTE m_ucPanelOffTiming1; / time between back light & data while turn off powerBYTE m_ucPanelOffTi
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